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28 nm Device Portfolio
Stratix V GX FPGA Features
Maximum Resource Count for Stratix V GX FPGAs (0.85 V) 1
5SGXA3 5SGXA4
5SGXA5
5SGXA7
5SGXA9
5SGXAB
5SGXB5
5SGXB6
5SGXB9
5SGXBB
ALMs
LEs (K)
128,300
340
158,500
420
185,000
490
234,720
622
317,000
840
359,200
952
185,000
490
225,400
597
317,000
840
359,200
952
Registers
513,200
634,000
740,000
938,880
1,268,000 1,436,800
740,000
901,600
1,268,000
1,436,800
M20K memory blocks
M20K memory (Mb)
MLAB memory (Mb)
Variable-precision
DSP blocks
18 x 18 multipliers
957
19
3.92
256
512
1,900
37
4.84
256
512
2,304
45
5.65
256
512
2,560
50
7.16
256
512
2,640
52
9.67
352
704
2,640
52
10.96
352
704
2,100
41
5.65
399
798
2,660
52
6.88
399
798
2,640
52
9.67
352
704
2,640
52
10.96
352
704
Global clock networks
Regional clock
networks
Design security
I/O voltage levels
supported (V)
I/O standards
supported
LVDS channels,
16
92
3
1.2, 1.5, 1.8, 2.5, 3.3 2
LVTTL, LVCMOS, PCI, PCI-X, LVDS, mini-LVDS, RSDS, LVPECL, Differential SSTL-15, Differential SSTL-18,
Differential SSTL-2, Differential HSTL-12, Differential HSTL-5, Differential HSTL-18, SSTL-15 (I and II),
SSTL-18 (I and II), SSTL-2 (I and II), 1.2 V HSTL (I and II), 1.5 V HSTL (I and II), 1.8 V HSTL (I and II)
1.4 Gbps
174
174
210
210
210
210
150
150
150
150
(receive/transmit)
Embedded DPA
circuitry
OCT
3
Series, parallel, and differential
Transceiver count
(14.1 Gbps)
PCIe hard IP blocks
(Gen3)
36
2
36
2
48
4
48
4
48
4
48
4
66
4
66
4
66
4
66
4
Memory devices
supported
DDR3, DDR2, QDR II, QDR II+, RLDRAM II, RLDRAM 3
1
2
All data is correct at the time of printing, and may be subject to change without prior notice. For the latest information, please visit www.altera.com .
3.3 V compliant, requires a 3 V power supply.
8
Altera Product Catalog
?
2013
?
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